Circuits logiques programmables : mémoires, PLD, CPLD et FPGA / Alexandre, Nketsa [ Livre]

Auteur principal: Nketsa, AlexandreLangue: Français ; de l'oeuvre originale, Français.Publication : Paris : Ellipses, 1998Description : VIII-246 pages ; 26 cmISBN: 2729867929.Collection: TechnosupClassification: 621.32 Automatique et informatique industrielleRésumé: Sommaire Chapitre I. Rappels sur la logique combinatoire 1. Généralités 2. Fonctions combinatoires de base 3. Algèbre de Boole et Lois de De Morgan 4. Représentation d'une fonction logique 5. Simplification des fonctions logiques 6. Structures de sortie des portes logiques 7. Circuits de moyenne complexité Chapitre II. Rappels sur la logique séquentielle 1. Généralités 2. Bascules asynchrones 3. Bascules synchrones 4. Résumé des tables de fonctionnement 5. Registres 6. Compteurs Chapitre III. Méthode de synthèse des systèmes séquentiels 1. Généralités 2. Etde d'un système séquentiel simple 3. Système séquentiel à évolution conditionnelle 4. Généralisation de la méthode de synthèse 5. Génération des sorties 6. Systèmes à évolutions parallèles Chapitre IV. Organisation et fonctionnement des mémoires 1. Généralités 2. Organisation de la mémoire 3. Fonctionnement d'une mémoire 4. Types de mémoire à semi-conducteur 5. Conséquence de l'adressage binaire sur l'organisation de la mémoire 6. Constitution des blocs mémoire 7. Application de la constitution des blocs mémoire : décodage d'adresse Chapitre V. Utilisation des mémoires mortes 1. Généralités 2. Réalisation des fonctions logiques combinatoires 3. Réalisation des systèmes séquentiels Chapitre VI. Circuits logiques programmables : PLD simples 1. Généralités 2. Classification des PLD 3. Structure des PLD simples 4. Circuits PLD simples de base Chapitre VII. Circuits logiques programmables : CPLD - FPGA 1. Structure des CPLD 2. Circuits CPLD de base 3. Structure des FPGA 4. Circuits FPGA de base Chapitre VIII. Chaîne de développement des PLD 1. Généralités 2. Structure du fichier source 3. Polarité des entrées, des sorties et des rebouclages 4. Méthode de développement d'une application.Sujet - Nom commun: Réseaux logiques programmables -- Manuels d'enseignement supérieur | Réseaux logiques programmables | Ordinateurs -- Mémoires | Industrie -- Informatique -- Manuels d'enseignement supérieur
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ENS Rennes - Bibliothèque
Sciences de l'ingénieur
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Avant-titre : "Informatique industrielle". PLD = Programmable logic devices. CPLD = Complex programmable logic devices. FPGA = Field programmable gate arrays

Sommaire
Chapitre I. Rappels sur la logique combinatoire
1. Généralités
2. Fonctions combinatoires de base
3. Algèbre de Boole et Lois de De Morgan
4. Représentation d'une fonction logique
5. Simplification des fonctions logiques
6. Structures de sortie des portes logiques
7. Circuits de moyenne complexité
Chapitre II. Rappels sur la logique séquentielle
1. Généralités
2. Bascules asynchrones
3. Bascules synchrones
4. Résumé des tables de fonctionnement
5. Registres
6. Compteurs
Chapitre III. Méthode de synthèse des systèmes séquentiels
1. Généralités
2. Etde d'un système séquentiel simple
3. Système séquentiel à évolution conditionnelle
4. Généralisation de la méthode de synthèse
5. Génération des sorties
6. Systèmes à évolutions parallèles
Chapitre IV. Organisation et fonctionnement des mémoires
1. Généralités
2. Organisation de la mémoire
3. Fonctionnement d'une mémoire
4. Types de mémoire à semi-conducteur
5. Conséquence de l'adressage binaire sur l'organisation de la mémoire
6. Constitution des blocs mémoire
7. Application de la constitution des blocs mémoire : décodage d'adresse
Chapitre V. Utilisation des mémoires mortes
1. Généralités
2. Réalisation des fonctions logiques combinatoires
3. Réalisation des systèmes séquentiels
Chapitre VI. Circuits logiques programmables : PLD simples
1. Généralités
2. Classification des PLD
3. Structure des PLD simples
4. Circuits PLD simples de base
Chapitre VII. Circuits logiques programmables : CPLD - FPGA
1. Structure des CPLD
2. Circuits CPLD de base
3. Structure des FPGA
4. Circuits FPGA de base
Chapitre VIII. Chaîne de développement des PLD
1. Généralités
2. Structure du fichier source
3. Polarité des entrées, des sorties et des rebouclages
4. Méthode de développement d'une application

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